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提示:此电路是组合逻辑电路(异或门)与时序逻辑电路(D触发器)的组合应用, 电路的初始状态由复位信号RD确定,输出状态在时钟脉冲信号CP的上升沿触发。
图示结构,各杆EI=常数,不计轴向变形,MBA及MCD的状况为: